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PDF ELANSC520 Data sheet ( Hoja de datos )

Número de pieza ELANSC520
Descripción Microcontroller
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Élan™SC520 Microcontroller
Register Set Manual
Order #22005B

1 page




ELANSC520 pdf
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TABLE OF CONTENTS
PREFACE
CHAPTER 1
CHAPTER 2
CHAPTER 3
INTRODUCTION
XV
Élan™SC520 Microcontroller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .xv
Purpose of this Manual . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .xv
Intended Audience . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .xv
Overview of this Manual . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .xv
Related Documents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . xvi
AMD Documentation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . xvi
Additional Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . xvii
Documentation Conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . xviii
CONFIGURATION REGISTER OVERVIEW
1-1
1.1 Memory-Mapped Configuration Region (MMCR) Registers. . . . . . . . . . . . 1-1
1.2 Direct-Mapped I/O Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1-7
1.3 PCI Host Bridge Indexed Configuration Registers . . . . . . . . . . . . . . . . . . 1-10
1.4 RTC and CMOS RAM Indexed Registers. . . . . . . . . . . . . . . . . . . . . . . . . 1-11
SYSTEM ADDRESS MAPPING REGISTERS
2-1
2.1 Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-1
2.2 Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-1
Address Decode Control (ADDDECCTL) . . . . . . . . . . . . . . . . . . . . . . . . . . 2-2
Write-Protect Violation Status (WPVSTA) . . . . . . . . . . . . . . . . . . . . . . . . . 2-4
Programmable Address Region 0 (PAR0) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 1 (PAR1) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 2 (PAR2) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 3 (PAR3) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 4 (PAR4) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 5 (PAR5) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 6 (PAR6) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 7 (PAR7) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 8 (PAR8) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 9 (PAR9) . . . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 10 (PAR10) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 11 (PAR11) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 12 (PAR12) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 13 (PAR13) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 14 (PAR14) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Programmable Address Region 15 (PAR15) . . . . . . . . . . . . . . . . . . . . . . . 2-5
Configuration Base Address (CBAR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-9
RESET GENERATION REGISTERS
3-1
3.1 Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-1
3.2 Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-1
System Board Information (SYSINFO). . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-2
Reset Configuration (RESCFG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-3
Reset Status (RESSTA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-5
SCP Data Port (SCPDATA). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-7
SCP Command Port (SCPCMD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-8
System Control Port A (SYSCTLA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-9
Élan™SC520 Microcontroller Register Set Manual
v

5 Page





ELANSC520 arduino
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Table of Contents
CHAPTER 17
REAL-TIME CLOCK REGISTERS
17-1
17.1 Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-1
17.2 Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-1
RTC/CMOS RAM Index (RTCIDX) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-2
RTC/CMOS RAM Data Port (RTCDATA) . . . . . . . . . . . . . . . . . . . . . . . . . 17-3
RTC Current Second (RTCCURSEC) . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-4
RTC Alarm Second (RTCALMSEC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-5
RTC Current Minute (RTCCURMIN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-6
RTC Alarm Minute (RTCALMMIN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-7
RTC Current Hour (RTCCURHR). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-8
RTC Alarm Hour (RTCALMHR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-9
RTC Current Day of the Week (RTCCURDOW). . . . . . . . . . . . . . . . . . . 17-10
RTC Current Day of the Month (RTCCURDOM) . . . . . . . . . . . . . . . . . . 17-11
RTC Current Month (RTCCURMON) . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-12
RTC Current Year (RTCCURYR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-13
RTC Control A (RTCCTLA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-14
RTC Control B (RTCCTLB) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-16
RTC Status C (RTCSTAC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-18
RTC Status D (RTCSTAD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17-20
General-Purpose CMOS RAM (114 bytes) (RTCCMOS) . . . . . . . . . . . . 17-21
CHAPTER 18
UART SERIAL PORT REGISTERS
18-1
18.1 Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-1
18.2 Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-1
UART 1 General Control (UART1CTL) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-3
UART 2 General Control (UART2CTL) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-3
UART 1 General Status (UART1STA) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-4
UART 2 General Status (UART2STA) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-4
UART 1 FIFO Control Shadow (UART1FCRSHAD) . . . . . . . . . . . . . . . . . 18-5
UART 2 FIFO Control Shadow (UART2FCRSHAD) . . . . . . . . . . . . . . . . . 18-5
UART 2 Transmit Holding (UART2THR) . . . . . . . . . . . . . . . . . . . . . . . . . . 18-7
UART 1 Transmit Holding (UART1THR) . . . . . . . . . . . . . . . . . . . . . . . . . . 18-7
UART 2 Receive Buffer (UART2RBR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-8
UART 1 Receive Buffer (UART1RBR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-8
UART 2 Baud Clock Divisor Latch LSB (UART2BCDL) . . . . . . . . . . . . . . 18-9
UART 1 Baud Clock Divisor Latch LSB (UART1BCDL) . . . . . . . . . . . . . . 18-9
UART 2 Baud Clock Divisor Latch MSB (UART2BCDH) . . . . . . . . . . . . 18-10
UART 1 Baud Clock Divisor Latch MSB (UART1BCDH) . . . . . . . . . . . . 18-10
UART 2 Interrupt Enable (UART2INTENB) . . . . . . . . . . . . . . . . . . . . . . 18-11
UART 1 Interrupt Enable (UART1INTENB) . . . . . . . . . . . . . . . . . . . . . . 18-11
UART 2 Interrupt ID (UART2INTID) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-12
UART 1 Interrupt ID (UART1INTID) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-12
UART 2 FIFO Control (UART2FCR). . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-15
UART 1 FIFO Control (UART1FCR). . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-15
UART 2 Line Control (UART2LCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-17
UART 1 Line Control (UART1LCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-17
UART 2 Modem Control (UART2MCR) . . . . . . . . . . . . . . . . . . . . . . . . . 18-19
UART 1 Modem Control (UART1MCR) . . . . . . . . . . . . . . . . . . . . . . . . . 18-19
UART 2 Line Status (UART2LSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-21
UART 1 Line Status (UART1LSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18-21
UART 2 Modem Status (UART2MSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 18-23
UART 1 Modem Status (UART1MSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 18-23
UART 2 Scratch Pad (UART2SCRATCH). . . . . . . . . . . . . . . . . . . . . . . . 18-25
UART 1 Scratch Pad (UART1SCRATCH). . . . . . . . . . . . . . . . . . . . . . . . 18-25
Élan™SC520 Microcontroller Register Set Manual
xi

11 Page







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Hoja de datos destacado

Número de piezaDescripciónFabricantes
ELANSC520MicrocontrollerAMD
AMD

Número de piezaDescripciónFabricantes
SLA6805M

High Voltage 3 phase Motor Driver IC.

 Sanken
Sanken
SDC1742

12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters.

 Analog Devices
Analog Devices


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